硬件工程师在准备笔试面试时，需要掌握一系列的芯片设计基础知识。以下为题库概览，供参考：
1. 给出一个门级图，提供门的传输延时，求关键路径和通过特定输入使得输出依赖于关键路径的方案。
2. 掌握数字电路的逻辑化简、时序差异、触发器类型、全加器等知识，使用卡诺图进行逻辑表达。
3. 化简给定的逻辑表达式为和的形式。
4. 绘制CMOS反相器的电路图、布局和横截面，并解释PMOS和NMOS在转移曲线各段的操作区域。
5. 设计一个具有平衡上升和下降时间的CMOS反相器，定义PMOS和NMOS通道宽度的比例并解释原因。
6. 说明标准CMOS反相器中P管宽长比大于N管的原因，与载流子迁移率关系。
7. 绘制二输入与非门的晶体管级电路图，并分析哪个输入对输出上升边缘响应更快。
8. 绘制NOT、NAND、NOR符号、真值表和晶体管级电路。
9. 绘制CMOS电路图，实现两到一多路复用器门。
10. 使用MUX和INV实现异或功能。
11. 绘制实现Y=A*B+C的CMOS电路图。
12. 使用逻辑门和CMOS电路实现AB+CD。
13. 绘制实现Y=A*B+C(D+E)的CMOS电路图。
14. 利用4选1实现给定表达式的逻辑函数。
15. 根据输入波形绘制由NOT、NAND、NOR组成的原理图。
16. 选择实现逻辑（AXORB）OR（CANDD）的逻辑门，并解释选择理由。
17. 使用与非门设计全加器。
18. 分析并比较两个门电路的异同。
19. 使用简单电路实现A为输入时，输出B波形。
20. 使用与非门实现投票逻辑，多数服从少数。
21. 用波形表示D触发器的功能。
22. 组装边沿触发器使用传输门和倒相器。
23. 绘制D触发器结构图并使用Verilog实现。
24. 绘制CMOS D锁存器电路图和版图。
25. 解释D触发器与D锁存器的区别。
26. 描述LATCH和DFF的概念和区别。
27. 比较latch与register的差异，解释为何现代设计中更倾向于使用register。
28. 组装二分频电路使用D触发器和与或非门。
29. 设计1位加法器，包含carryin和current-stage输入，输出carryout和next-stage。
30. 实现N位Johnson计数器，N=5。
31. 设计7进制和15进制循环计数器。
32. 了解可编程逻辑器件，并用VHDL或VERILOG描述8位D触发器。
33. 解释BLOCKING和NONBLOCKING赋值的区别。
34. 梳理芯片设计流程，包括需求分析、架构设计、功能设计、验证、综合与优化、物理设计、验证与模拟、制造准备、生产与测试和发布维护。
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回答时间：2025-03-20 17:00
